用38译码器设计全加器,38译码器设计全加器电路图

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本文目录一览：

• 1、利用3/8译码器实现一位全减器与实现一位全加器有何异同
• 2、用3线-8线译码器74HC138和门电路设计一个全加器
• 3、反偏最小电流和电压的关系
• 4、采用74138译码器与采用逻辑门实现的全加全减器,哪种电路更简单?_百度...
• 5、如何设计全加器电路?

利用3/8译码器实现一位全减器与实现一位全加器有何异同

是采用74138译码器实现的全加器和全减器电路更简单，一片译码器加一片74LS20（即二-4输入与非门）就可以完成。与3-8译码器比较，3-8译码器有3个数据输入端：A，B，C；3个使能端；8个输出端，OUT（0-7）。

全加器与全减器的异同主要如下：相同的方面主要二者都是二进制范畴的计算单元，不同的是二者的计算逻辑不一样。全加器能同时进行本位数和相邻低位的进位信号的加法运算。

首先得弄清楚全加器的原理，你这里说的应该是设计1位的全加器。全加器有3个输入端：a，b，ci；有2个输出端：s，co.与3-8译码器比较，3-8译码器有3个数据输入端：A，B，C；3个使能端；8个输出端，OUT（0-7）。

全减器真值表如下：其中Ai和Bi表示二进制数的第i位，Ci表示本位最终运算结果，即就是低位向本位借位或本位向高位借位之后的最终结果，Di-1表示低位是否向本位借位，Di表示本位是否向高位借位。

其中，一位全加器（FA）的逻辑表达式为：S=A⊕B⊕Cin Co=（A⊕B）Cin+AB 其中A、B为要相加的数，Cin为进位输入；S为和，Co是进位输出。

ls139是双2线-4线译码器，只有4个输出Y0~Y3，是不能设计一位全加器或全减器。

用3线-8线译码器74HC138和门电路设计一个全加器

1、首先得弄清楚全加器的原理，你这里说的应该是设计1位的全加器。全加器有3个输入端：a，b，ci；有2个输出端：s，co.与3-8译码器比较，3-8译码器有3个数据输入端：A，B，C；3个使能端；8个输出端，OUT（0-7）。

2、对应3-8译码器的输入为A=1，B=0，C=1，这是译码器对应的输出为OUT（5）=1，其余的为0，根据上面设计的连接关系，s=0，co=1，满足全加器的功能，举其他的例子也一样，所以，设计全加器的设计正确。

3、HC138是高速硅栅CMOS解码器，适合内存地址解码或数据路由应用。74HC138作用原理于高性能的存贮译码或要求传输延迟时间短的数据传输系统，在高性能存贮器系统中，用这种译码器可以提高译码系统的效率。

4、先纠正一下，不是74H138，没有这个型号的器件，应该是74HC138（3-8译码器）。单用一片74HC138无法实现全加器功能，还要加一片双通道的4输入与非门（74HC20）。

反偏最小电流和电压的关系

如果pn结加正向偏置电压p（＋）n（－）就会加据扩散运动而抑制飘逸运动，当然扩散运动是多子的扩散，所以加正向电压会形成一定的电流。

二极管反偏时，在达到反向（击穿电压）之前通过电流很小，称为（反向饱和）电流。

电压表，电流表 满偏：达到量程最大值之后，超过这个最大值仍向右偏。说明量程不够，或电流（电压）异常。反偏：指针向左指向零的左边。说明电流（电压）反向。

采用74138译码器与采用逻辑门实现的全加全减器,哪种电路更简单?_百度...

全加器英语名称为full-adder，是用门电路实现两个二进制数相加并求出和的组合线路，称为一位全加器。一位全加器可以处理低位进位，并输出本位加法进位。多个一位全加器进行级联可以得到多位全加器。

都可以用3/8译码器实现，具体的电路设计会有所不同。

组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入，与电路原来的状态无关。

缺点：①对于比较简单的组合电路，相对于全门电路形式没有优势。②译码器在逻辑系统中使用率较低，不容易获得。③门电路的输入端数可能较多。用门电路 优点：①设计简单，实现起来比较直观。

如何设计全加器电路?

1、将3-8译码器的输出OUT（7）作为一个4输入的或门的输入，或门的输出作为加法器的和；将3-8译码器的输出OUT（7）作为一个4输入的或门的输入。或门的输出作为加法器的进位输出。即完成了加法器的设计。

2、可以设计出电路图：将3-8译码器的输出OUT（7）作为一个4输入的或门的输入，或门的输出作为加法器的和；将3-8译码器的输出OUT（7）作为一个4输入的或门的输入，或门的输出作为加法器的进位输出。

3、全加器是能够计算低位进位的二进制加法电路。

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